Xilinx公布Versal Premium更多细节

2020-08-19来源: servethehome关键字:Xilinx  Versal  ACAP

Xilinx在Hot Chips 2020上展示了更多关于Versal Premium的信息。


Xilinx Versal Premium概述


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Xilinx Versal Premium其中一个重要的特性是集成的shell,它预先构建了很多功能,这样FPGA RTL程序员就不必从头开始就可以使用Versal。一开始这可能没有意义,但它允许诸如PCIe和DDR接口之类的功能在引导时可用,而不必设置逻辑。


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由于系统中有所有不同的逻辑块和I/O,Xilinx正在推出其具有QoS等特性的片上网络或NoC方法。


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Xilinx说,Versal NoC并不是完全固定的。因此,它可以针对给定的应用程序进行扩展和配置,并在Tbps范围内运行。


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通过内存子系统,Versal Premium可以使用DDR4和LPDDR4内存。当然,Xilinx还可以访问其他内存。


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Xilinx表示,由于其I/O和强化的协议引擎IP,Versal Premium可相当于22个Virtex FPGA。


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让我们来了解一些特性。


Xilinx Versal高级功能


虽然Intel Agilex主要关注外部,但Xilinx有一种不同的方式来概念化I/O以及FPGA(或者ACAP)上的强化逻辑


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Xilinx非常关注Versal Premium的连接特性。例如,可以添加诸如以太网和Interlaken的特性以及到定制ASIC集成的连接性,一个例子是构建一个1.2Tbps的智能PHY。


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Versal Premium具有多达600G多速率以太网或DCMAC。它们可以处理6x 100GbE、3x 200GbE或1x 400GbE。


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还有一个低速100G多速率以太网(MRMAC)选项。向下兼容,如10GbE、25GbE和50GbE。


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600G Interlaken对于将Verasal Premium整合到更大的解决方案中非常重要。


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由于许多FPGA都是加密加速非常重要的结构的一部分,Versal Premium拥有大型的强化加密加速器,可以满足400GbE端口的需求。对于许多需要高速加密的应用程序,添加FPGA是添加高速密码的一种灵活而简单的方法,即使在部署之后,也可以在可编程逻辑中添加附加功能。


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在芯片上和芯片外获取数据需要高速SerDes。Xilinx在这里有一些解决方案,包括两种不同的SerDes。


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Xilinx有两种不同类型的Serdes。有一个更高端的版本以及更优化的空间解决方案,GTM用于长距离PAM4等应用。


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112Gbps接口的设计是为了提供低功耗的接口。


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下面是协议引擎和SerDes的摘要。


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Xilinx Versal Premium协议引擎和SerDes摘要


我们想讨论更多关于连通性的问题。


Versal Premium PCIe Gen5、CXL和CCIX


Xilinx Versal Premium内置PCIe Gen5和CCIX。Xilinx是CCIX的主要推动者,因此我们可以看到它紧密地集成在FPGA中。


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第二个块是基于PL的PCIe Gen5和CXL。这两者都是需要可编程逻辑。到2021年底,我们将在CXL上看到更多。Versal似乎是为CCIX设计的,但后来业界在设计和部署之间转向了CXL。FPGA的一个很酷的特性是Xilinx可以通过将一些功能转移到可编程逻辑中来支持CXL。


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这些是大芯片,但我们想展示一些芯片是如何制造的。


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Versal Premium芯片通过该公司的堆叠式硅中间层技术(SSIT)集成多个芯片,可以达到920亿个晶体管。这利用了台积电的CoWoS技术。


这种方法允许Xilinx制造更大的芯片,而不必创建更大的单片模具。


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Versal设计可根据连接性和功能进行上下缩放,在高端,肯定有一些大的解决方案可以构建。


最后的话


这无疑是一个有趣的解决方案。我们一直在努力展示我们实验室中的一些FPGA解决方案,它们从需要编程和集成知识到更类似于插件加速器的东西。


关键字:Xilinx  Versal  ACAP 编辑:冀凯 引用地址:http://news.2689mr.com/FPGA/ic506826.html 本网站转载的所有的文章、图片、音频视频文件等资料的版权归版权所有人所有,本站采用的非本站原创文章及图片等内容无法一一联系确认版权者。如果本网所选内容的文章作者及编辑认为其作品不宜公开自由传播,或不应无偿使用,请及时通过电子邮件或电话通知我们,以迅速采取适当措施,避免给双方造成不必要的经济损失。

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